<module area="" description="VectorVectorMult" issues="" name="VectorVectorMult" purpose="VectorVectorMult" speed="" title="VectorVectorMult" tool="ISE 13.1" version="1.0">

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    <offered alias="VectorVectorMult" name="VectorVectorMult">
         <map actual="VectorInput1" formal="VectorInput1"/>
         <map actual="VectorInput2" formal="VectorInput2"/>
         <map actual="ScalarOutput" formal="ScalarOutput"/>
    </offered>
  </services>
  
  <input name="Clk" size="1" type="logic"/>
  <input name="Rst" size="1" type="logic"/>
  
  <input  name="VectorInput1" size="64" type="logic"/>
  <input  name="VectorInput2" size="64" type="logic"/>
  <output name="ScalarOutput" size="32" type="logic"/>
  
  <features>
    <design Latency="12" DataIntroductionInterval="9"/>
    <fpga id="XC7VX485T">
	<resources lut="16" register="0" ram="0"/>
	<clock MaxFreq="100"/>
    </fpga>
    <fpga id="XC6VLX240T">
	<resources lut="16" register="0" ram="0"/>
	<clock MaxFreq="100"/>
    </fpga>
    <fpga id="XC6SLX150">
	<resources lut="16" register="0" ram="0"/>
	<clock MaxFreq="100"/>
    </fpga>
    <fpga id="XC5VSX50T">
	<resources lut="16" register="0" ram="0"/>
	<clock MaxFreq="200"/>
    </fpga>
  </features>
  
  <services>
    <required name="reset" type="orthogonal" version="1.0">
      <map actual="Rst" formal="reset"/>
<!--      <map actual="0" formal="delay"/>-->
    </required>
    <required name="clock" type="orthogonal" version="1.0">
      <map actual="Clk" formal="clock"/>
<!--      <map actual="50" formal="freq"/>-->
    </required>
  </services>
  
  <core>
    <rtl path="./src/VectorVectorMult.vhd"/>
  </core>
</module>

